更新时间:2026-10-09
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静电学的起点是电荷。两个点电荷之间的作用力由库仑定律描述:
电场强度定义为单位正电荷所受的力:
电势与电场的关系为:
高斯定理给出电场与电荷分布的联系:
其中 , 为介质极化强度。在线性各向同性介质中,。将 代入,可得泊松方程:
在无电荷区域,泊松方程退化为拉普拉斯方程:
这些方程是分析静电问题的基本工具。导体在静电平衡时内部电场为零,整个导体为等势体,净电荷分布在表面。表面电场与面电荷密度满足:
导体表面曲率越大,局部电场越强,附近容易发生电晕放电。这也是静电放电常从尖锐电极起始的原因。
介质中的边界条件为:
电容和储能公式为:
对 ESD 而言,能量公式尤为关键。人体电容约为 100~200 pF,若人体带电压 10 kV,则储能约为毫焦量级,足以损坏许多半导体器件。
两种材料接触时,电子会从费米能级较高的一侧流向较低的一侧,直到费米能级平衡。接触电势差可写为:
其中 为功函数。分离后,若电荷来不及中和,两种材料就分别带正电和负电。摩擦的作用是增加接触面积、接触次数和分离频率,本质仍是接触-分离起电。
带电体靠近导体时,导体内自由电荷重新分布,靠近端带异号电荷,远端带同号电荷。若将远端接地后再移走接地线和带电体,导体可留下净电荷。
介质在电场中发生极化,形成束缚电荷。极化机制包括电子极化、离子极化、偶极取向极化和界面极化。不同机制的响应频率不同,因此介电常数常随频率变化。
材料上的电荷会通过体积电导和表面电导逐渐泄放。弛豫时间可近似为:
其中 为介电常数, 为电导率。对绝缘体, 可以很长,电荷难以自行泄放;对静电耗散材料, 适中,既能缓慢泄放,又不会形成大电流。工程上常按表面电阻分类:
导电材料:低于 ;
静电耗散材料:约 ;
绝缘材料:高于 。
湿度升高通常增加表面电导率,缩短弛豫时间,因此湿度控制是静电防护的重要环节。
当局部电场超过空气击穿场强时,空气电离形成放电通道。均匀电场下干燥空气的击穿场强约为:
电极会产生电晕放电,使局部击穿电压降低。气体放电的经典描述包括汤森放电和帕邢定律:
其中 为气压, 为间隙距离。放电发展可经历电晕、流注、火花和电弧等阶段。
ESD 是带电体之间或带电体与接地体之间的快速电荷转移。常见模型包括:
HBM:人体模型,约 100 pF 串联 1.5 kΩ,脉冲在微秒量级;
CDM:带电器件模型,上升时间可短至 200 ps 以下,峰值电流可达数安培;
IEC 61000-4-2:系统级测试,接触放电常为 8 kV。
ESD 的瞬时功率很高,但持续时间短。焦耳热在局部区域集中,可导致金属熔融、结损伤或氧化层击穿。
半导体中的静电问题与普通导体、绝缘体不同,因为半导体具有可控的载流子浓度和能带结构。
在半导体中,泊松方程写为:
其中 为静电势, 和 为电子、空穴浓度, 和 为电离杂质浓度。电场引起能带弯曲,而能带弯曲又改变载流子分布,二者通过泊松方程和载流子统计自洽耦合。
在耗尽近似下,例如 p 型半导体耗尽区:
由此可得到耗尽层宽度、内建电势和势垒电容。pn 结内建电势为:
这些量决定了器件内部的静电场分布,也决定了 ESD 发生时电流路径和电压分配。
MOS 电容是理解半导体静电物理的核心结构。栅氧电容为:
栅氧中的电场为:
随着工艺微缩, 减至原子层级,同样的电压会在栅氧中产生更强的电场。栅氧击穿机制包括:
Fowler-Nordheim 隧穿;
直接隧穿;
雪崩击穿;
陷阱辅助击穿;
软击穿与硬击穿。
在先进 CMOS 中,栅氧击穿电场约为 10 MV/cm 量级。若栅氧厚度只有几个原子层,数伏的瞬态过压就可能造成不可逆损伤。因此,ESD 保护电路需要在很短的时间内将电压钳位到安全范围。
金属与半导体接触会形成肖特基势垒或欧姆接触,其静电势分布由功函数差、表面态和界面层共同决定。表面态可在禁带中引入能级,捕获电荷,改变表面势和耗尽层宽度。在 ESD 事件中,表面态和界面陷阱会影响保护器件的触发电压、维持电压和失效路径。
HBM 的脉冲持续时间较长,保护电路有相对充裕的响应时间。CDM 的上升时间在亚纳秒量级, 很大,寄生电感和电容会引起明显的电压过冲。CDM 电流路径往往经过芯片内部,而不是仅经过 I/O 保护器件,因此核心电路也可能承受应力。
CDM 损伤常表现为:
栅氧击穿:高电场在薄氧化层中形成导电细丝;
局部热熔:高密度电流在金属互连、接触孔或多晶硅中产生焦耳热;
潜在损伤:参数漂移或寿命下降,出厂测试可能未发现。
先进封装中的 TSV、微凸块和 HBM 堆叠结构对 CDM 更敏感,部分结构在低于 100 V 的放电条件下就可能受损。FinFET 和 GAA 结构的三维沟道也改变了电流分布和散热路径,使版图设计对 ESD 鲁棒性影响更大。
半导体制造中的等离子体刻蚀、离子注入、CVD、PVD、湿法清洗和旋转移干都可能产生表面电荷。等离子体中的电子和离子通量不平衡会使晶圆带电;去离子水冲洗和旋转干燥会产生流动起电;与高分子材料接触和分离会产生摩擦起电。
这些电荷会影响颗粒吸附、光刻对准、薄膜应力和器件参数。产线通常采用离子风机、静电耗散材料、接地和湿度控制来管理电荷。离子化设备用于中和绝缘体表面电荷,因为绝缘体无法通过接地直接泄放。
静电物理的工程测量包括:
非接触式静电电压表:测量表面电位;
静电场计:测量电场强度;
法拉第杯:测量总电荷量;
表面电阻仪:评估材料导电或耗散等级;
静电衰减测试仪:测量电荷衰减时间;
离子平衡测试仪:测量离子风机正负离子平衡和消电时间。
器件级 ESD 测试则依据 JEDEC、AEC-Q 和 IEC 等标准进行 HBM、CDM 和系统级放电验证。
静电物理的核心是电荷、电场、电势和介质极化之间的耦合。对半导体而言,这些基本规律直接体现在耗尽层、MOS 电容、栅氧电场、金属-半导体接触和 ESD 保护设计中。随着栅氧减薄、封装三维化和器件尺寸缩小,静电放电的物理过程从“外部电荷泄放"扩展到“芯片内部瞬态电流与电压分配"。理解泊松方程、电荷弛豫、气体放电和半导体能带弯曲,是分析 ESD 失效机理和设计防护方案的基础。
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